基于FPGA的網(wǎng)絡(luò)協(xié)議處理器設(shè)計及驗證.pdf_第1頁
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文檔簡介

1、隨著嵌入式系統(tǒng)應(yīng)用領(lǐng)域的不斷擴展,諸如手持式智能終端等嵌入式設(shè)備接入Internet已成為技術(shù)主流。嵌入式Internet技術(shù)面臨的主要困難是標準Internet協(xié)議對于計算機存儲器容量、運算速度等方面的要求比較高,從而對處理器運算速度、存儲空間以及功耗要求較高。因而,對于嵌入式Internet技術(shù)需要針對嵌入式系統(tǒng)的計算能力、存儲資源和能耗等進行限制,對標準的Internet協(xié)議進行裁剪和移植。通過將部分協(xié)議遷移到硬件中實現(xiàn),降低對核

2、心處理器的資源需求,提高系統(tǒng)性能并降低系統(tǒng)能耗。本文研究了以太網(wǎng)MAC協(xié)議,分析了MAC協(xié)議中數(shù)據(jù)幀格式和CSMA/CD的基本原理,設(shè)計了基于FPGA的MAC協(xié)議處理器。論文對整個系統(tǒng)的內(nèi)部結(jié)構(gòu)、模塊劃分及各模塊的設(shè)計過程進行了詳細闡述。
　　 另一方面,隨著芯片設(shè)計的規(guī)模不斷擴大和設(shè)計復(fù)雜程度的增大,功能驗證成為硬件設(shè)計中的最大挑戰(zhàn)。目前,基于斷言的驗證技術(shù)由于其抽象程度高、描述能力強且能夠?qū)﹀e誤進行定位等優(yōu)點,成為一種重要的

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