32位嵌入式RISC處理器核的VLSI實現.pdf_第1頁
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文檔簡介

1、我們設計了一個與商用ARM7兼容的32位嵌入式RISC處理器.在ARM7的基礎上,對結構進行了適當的改進以提高性能.傳統(tǒng)的馮諾依曼結構被哈佛結構所取代,流水線的深度從三級增加到五級.為減少流水線的互鎖,提高CPI的值,還在流水線中引進了特殊的旁路電路.同時,考慮到DSP擴展功能的需要,將乘法指令的執(zhí)行時間從四個時鐘周期減小到了兩個周期.另一方面,面向Internet應用的嵌入式系統(tǒng)產品一直深受人們的關注.我們在RISC處理器的基礎上,增

2、加了對Java功能的支持,使得處理器除本地指令集外,能夠額外支持Java卡虛擬機規(guī)范.通過結合市場上成熟的Java處理器,在自己的設計中,采用了一系列硬件加速技術來提高Java指令的執(zhí)行效率.最后,我們使用了兩種硬件驗證技術:Xilinx通用FPGA板和Aptix公司提供的System Explorer MP3CF硬件驗證器進行系統(tǒng)硬件驗證.在CSMC0.6um單元庫上進行了邏輯綜合,并完成最后的版圖設計,采用了CPGA132標準封裝.

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