基于FPGA及以太網(wǎng)技術(shù)的100G接口板設計.pdf_第1頁
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文檔簡介

1、近年來，隨著IT行業(yè)的高速發(fā)展，高清視頻、虛擬化、電子商務、無線3G以及4G網(wǎng)絡等各種新興業(yè)務不斷涌現(xiàn)，人們對于網(wǎng)絡帶寬的需求正在飛速增長，而云計算的出現(xiàn)及部署更加速了人們對網(wǎng)絡帶寬需求的增長，這勢必導致網(wǎng)絡匯聚節(jié)點網(wǎng)絡帶寬的成倍增長。高端路由器作為在數(shù)據(jù)中心和骨干網(wǎng)絡層使用的關(guān)鍵互聯(lián)設備，其10G端口已不能滿足業(yè)務對于帶寬的需求，研究和開發(fā)支持100G端口的以太網(wǎng)設備就變得十分必要和迫切了。
　　以往的以太網(wǎng)設備，多是以專用的網(wǎng)

2、絡處理芯片為主體設計的，而專用芯片的設計不夠靈活、移植性不強，而且價格昂貴，導致以太網(wǎng)設備成本高。本文結(jié)合可編程邏輯器件設計靈活、可移植性強的特點，采用Altera公司最新StratixV可編程邏輯器件，設計一套以兩片F(xiàn)PGA為主體的系統(tǒng)方案，兩片F(xiàn)PGA分別進行包處理和流量管理，可實現(xiàn)完善的100G路由轉(zhuǎn)發(fā)功能。
　　硬件設計部分對系統(tǒng)的主要功能模塊:MPU模塊、FPGA模塊、CFP模塊以及
　　電源和時鐘模塊進行詳細設計

3、。理論研究在參閱了IEEE802.3ba標準及其相關(guān)會議文稿的基礎上，對100G以太網(wǎng)物理層架構(gòu)及其實現(xiàn)上進行深入研究，詳細闡述64B/66B的編解碼、并行自同步擾解碼以及PCS層MLD通道分發(fā)機制的原理，并用verilogHDL語言對其進行設計，在modelsim上對其各個部分進行仿真，驗證邏輯設計的正確性。
　　最后在系統(tǒng)層面上對其進行測試設計，結(jié)合100G CFP光模塊，用spirent公司的testcenter專業(yè)打流測試

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